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      Entrevista para Senior Verification Engineer

      9 de abr. de 2014
      Candidato(a) sigiloso(a) à entrevista
      San Jose, CA
      Nenhuma oferta
      Experiência neutra
      Entrevista com nível médio de dificuldade

      Candidatura

      Candidatei-me por meio de recrutador(a). O processo levou mais de 1 semana. Fui entrevistado pela Cadence Design Systems (San Jose, CA) em mar. de 2014

      Entrevista

      Contacted by HR thru LinkedIn. Set up an short hr discussion followed by phone interview. Technical phone interview: General resume questions Experience OVM/UVM basic questions How will u tell size of an array without using foreach construct of Sys verilog MESI/MOSI Small team was looking for senior person. So not selected

      Perguntas de entrevista [1]

      Pergunta 1

      nothing specific
      Responder à pergunta
      2

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